Les chipsets deviennent physiques : l'époque du mélange et de l'association du silicium approche

Les chipsets deviennent physiques : l'époque du mélange et de l'association du silicium approche

Les chipsets sont des puces semi-conductrices modulaires conçues pour être combinées comme des blocs de construction, permettant aux ingénieurs de mélanger et d'associer du silicium spécialisé de différents fabricants dans un seul boîtier hautes performances. Ce changement architectural réécrit fondamentalement les règles de conception des puces – et les effets d’entraînement remodèleront tous les secteurs qui dépendent de la puissance de calcul, de l’IA et de l’infrastructure cloud aux outils commerciaux qui gèrent les entreprises modernes.

Que sont exactement les chiplets et pourquoi remplacent-ils les puces monolithiques ?

Pendant des décennies, l’industrie des semi-conducteurs a fonctionné selon un principe simple : entasser autant de transistors que possible sur une seule puce monolithique. Cela fonctionnait à merveille lorsque la loi de Moore restait stable, doublant la densité des transistors tous les deux ans. Mais à mesure que les limites physiques se resserraient et que les coûts de fabrication des nœuds de pointe comme ceux de 3 nm et 2 nm montaient en flèche, les aspects économiques de la conception monolithique ont commencé à se fissurer.

Les chiplets résolvent ce problème en désagrégeant les fonctions des puces en matrices plus petites et fabriquées indépendamment. Un processeur peut combiner une puce de calcul hautes performances réalisée selon un processus de 3 nm avec un contrôleur de mémoire rentable construit sur un nœud mature de 7 nm – connecté via des technologies de packaging avancées telles que l'EMIB d'Intel ou l'Infinity Fabric d'AMD. Le résultat est une puce qui atteint les meilleures performances de sa catégorie pour chaque fonction sans forcer chaque composant à passer par le processus de fabrication le plus coûteux.

Les processeurs EPYC d'AMD et les puces de la série M d'Apple avec leur architecture UltraFusion en sont les premiers éléments de preuve. L’ère du silicium mix-and-match n’est pas théorique : elle est déjà en production et prend rapidement de l’ampleur.

Comment l’écosystème Chiplet prend-il réellement forme ?

La transition des implémentations de chipsets propriétaires vers un écosystème ouvert et interopérable constitue le développement critique de cette décennie. La norme Universal Chiplet Interconnect Express (UCIe), soutenue par Intel, AMD, ARM, TSMC et Samsung, a établi une couche physique et protocolaire commune qui permet aux chipsets de différents fournisseurs de communiquer de manière fiable.

Cette normalisation ouvre une nouvelle dynamique de chaîne d’approvisionnement :

Les fournisseurs de chipsets spécialisés peuvent créer les meilleures puces de leur catégorie pour des fonctions spécifiques (accélérateurs d'IA, interfaces mémoire à large bande passante, processeurs de sécurité) et les vendre à n'importe quel intégrateur de systèmes.

Les concepteurs de puces Fabless ont la possibilité de se procurer des chipsets de calcul, de mémoire et d'E/S de manière indépendante, réduisant ainsi les délais de mise sur le marché et les risques financiers.

Les hyperscalers du cloud comme Google, Microsoft et Amazon conçoivent des piles de silicium personnalisées à l'aide de chipsets pour optimiser le coût par charge de travail à grande échelle.

Les équipementiers automobiles et industriels peuvent assembler des processeurs spécifiques à un domaine sans le coût prohibitif d'une conception entièrement personnalisée en silicium à partir de zéro.

L’émergence de marchés de chipsets – où des puces pré-validées peuvent être concédées sous licence et intégrées – indique que le silicium commence à fonctionner davantage comme des composants logiciels que comme du matériel sur mesure.

Quels sont les plus grands défis techniques et commerciaux qui freinent les chiplets ?

Malgré cette promesse, l’adoption des chiplets ne se fait pas sans frictions. La gestion thermique d’un boîtier multi-puces est nettement plus complexe que le refroidissement d’une puce monolithique. L’intégrité du signal au niveau des interconnexions die-to-die exige un conditionnement de précision que seule une poignée d’OSAT (sociétés externalisées d’assemblage et de test de semi-conducteurs) peuvent fournir de manière fiable à grande échelle.

"La partie la plus difficile de la conception des chipsets n'est pas le silicium, mais l'intégration. Le packaging avancé est désormais le nouveau champ de bataille pour la différenciation concurrentielle, et sa maîtrise distinguera la prochaine génération de leaders en matière de puces des autres."

Du côté des entreprises, la protection de la propriété intellectuelle devient compliquée lorsque les chipsets de plusieurs fournisseurs sont combinés dans un seul package. Les tests et la gestion du rendement évoluent également : un défaut dans un chipset peut compromettre l'ensemble d'un package assemblé, nécessitant

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